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基于单电子晶体管的逻辑电路设计

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毕业论文范文题目：基于单电子晶体管的逻辑电路设计，论文范文关键词：基于单电子晶体管的逻辑电路设计
基于单电子晶体管的逻辑电路设计毕业论文范文介绍开始：
【论文摘要】：自集成电路问世以来,半导体集成电路集成度始终进步,使得传统微电子器件的利用跟发展将面临前所未有的妨碍。在未多少的将来传统CMOS技巧将达到其机能的极限,因此寻找一种可能持续缩小并且不受极限效应制约的新型器件构造至关重要。单电子晶体管不仅存在在纳米标准呈现的典范的量子效（略..）应,还存在集成度高、功耗小、器件运行速度快等特点,有望成为新型集成化器件构造之一。当前单电子晶体管的研究重要集中在单电子晶体管制备的研究,单电子晶体管的仿真模型研究跟基于单电子晶体管的电路设计研究。本文在深刻分析了单电子晶体管的电学特点跟现有单电子晶体管电路设计不足之（文章此处忽略..）处的基本上,首先,通过对单栅极SET背景电荷恰当的设置,使之在特定电压区间内存在类似PMOS或NMOS的电学特点；引入传输电压开关实际,领导单栅极SET逻辑电路的开关级设计。其次,本文利用双栅极SET存在电压-电流异或的特点,实现了以四个SET组成的电压-电压异或电路（文章此处忽略..）；同时引入了Reed-Muller代数体系(与异或代数体系),领导SET电路的门级电路设计。最后,利用对背景电荷的设置,实现了耗尽型PSET;并将耗尽型PSET作为上拉电阻,调换了混淆MOS/SET构造中的耗尽型NMOS,构建了NSET逻辑门；利用NSET逻辑门设计了多种（本文此处忽略..）触发器,同时候析了各种触发器的优毛病；并用保持梗阻型D触发器进行了SET的时序电路设计。经仿真表明文中所设计的电路岂但存在正确的逻辑功能跟良好的输入输出电压兼容性,而且还存在功耗低、延迟小、构造简单的特点,这也进一步验证了文中的各种电路设计方法的正确跟实用。

以上为本篇毕业论文范文基于单电子晶体管的逻辑电路设计的介绍部分。

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