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音频DAC数字通路的研究与优化

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毕业论文范文题目：音频DAC数字通路的研究与优化，论文范文关键词：音频DAC数字通路的研究与优化
音频DAC数字通路的研究与优化毕业论文范文介绍开始：
【论文摘要】：21世纪以来,音频电子产品市场增长势头迅猛,越来越多的消费电子产品如MP3播放器、PMP等都要求高品质音频功能。而实现此功能需要高性能的音频编解码芯片,因此研究音频系统中的DAC具有广泛的现实意义。本文重点研究了音频DAC中的数字部分:过采样插值滤波器和数字ΔΣ调制器。详细分析了（文章此处忽略..）过采样技术、插值滤波器的原理以及数字ΔΣ调制器的原理、结构和稳定性。对于插值滤波器,首先选择合适的数字滤波器,然后根据系统的设计指标采用多级实现插值滤波器,最后在算法级分别设计、优化和仿真验证插值滤波器;对于数字ΔΣ调制器,首先选择合适的结构,然后根据理论分析和matlab（文章此处忽略..）仿真结果,确定数字ΔΣ调制器的阶数和量化比特数,最后根据系统设计指标与电路面积的考虑,在算法级设计、优化和仿真验证数字ΔΣ调制器。采用VerilogHDL电路实现整个音频DAC的数字部分;为了节省电路面积,利用了多种方式,如采用CSD编码实现常系数乘法器,优化ΔΣ调制器的系（本文此处忽略..）数以减少乘法器数量,插值滤波器的实现采用时分复用共享乘法器等;为了降低功耗,对半带滤波器采用了多相分解技术。此外,通过FPGA的综合实现来验证整个系统的正确性。对于CIC滤波器,提供了一种易于RTL实现并能有效补偿通带衰减的方法。本文通过对ΔΣDAC理论的深入研究,尤其是插（文章此处忽略..）值滤波器和数字ΔΣ调制器部分,设计并实现了音频DAC的数字部分,最后通过了FPGA综合仿真验证,一共使用了1971个LE,3672bit的嵌入式RAM,电路规模大约为3万门。最后对后仿真的结果进行测试,其信噪比可达到102.83dB,完全达到了预期的设计指标。

以上为本篇毕业论文范文音频DAC数字通路的研究与优化的介绍部分。

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