基于视频紧缩算法的硬件模板设计跟可重构阵列架构研究

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基于视频紧缩算法的硬件模板设计跟可重构阵列架构研究

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基于视频紧缩算法的硬件模板设计跟可重构阵列架构研究毕业论文范文介绍开始：
【论文摘要】：跟着视频利用的日益广泛,传统的通用处理器跟专用集成电路已经不能满意视频利用对高机能的须要,可重构打算的呈现弥补了二者之间的空白,其阵列式的构造特别合适视频利用中数据并行度大跟运算密集度高算法。本文分析AVS、MEPG-2跟H.264三个视频紧缩标准,从中抉择适于在（文章此处忽略..）可重构阵列中履行的算法,针对可重构多媒体处理器REMUS跟其可重构编译器平台,对这些算法进行数据流图的提取跟映射,手工生成REMUS中可重构阵列RCA可履行的配置字,称为硬件模板。对这些模板进行硬件仿真分析,与ARM7处理器软件仿真成果的对比显示,模板存在14.（此处忽略..）60~42.22的加强加速比跟1.095~1.235的体系加速比,表明可重构阵列对这些算法存在很好的加速后果。在分析可重构阵列RCA跟硬件模板设计的基本上,针对RCA存在的问题,本文提出一种改进架构V-RCA,从新设计处理单元PE构造,增加互联才能,简化数据存储与传输机制,算法映射的（文章此处忽略..）成果对比显示,V-RCA的打算资源利用率是RCA的2~8倍,并且在PE数量雷同情况下,V-RCA可映射数据流图节点是RCA的2~8倍,存在更高的映射效力。本文对V-RCA进行RTL级硬件建模,在TSMC90nm工艺下综合,芯片面积为1.38mm2,工作频率100Mhz,算法仿真的成（略..）果显示,针对模板对应的算法,V-RCA可能满意1080p高清视频实时解码的须要。以2D-DCT机能为比较基准,将V-RCA与其它架构比拟较,成果显示V-RCA存在更高的面积效力。

以上为本篇毕业论文范文基于视频紧缩算法的硬件模板设计跟可重构阵列架构研究的介绍部分。

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