基于时序等价性检查的组合逻辑单元软错误坚固性分析

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基于时序等价性检查的组合逻辑单元软错误坚固性分析

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基于时序等价性检查的组合逻辑单元软错误坚固性分析毕业论文范文介绍开始：
【论文摘要】：跟着IC制造工艺的始终进步，组合逻辑电路中电气粉饰效应跟时钟窗口粉饰效应都被极大程度的减弱了。最新研究指出IC设计的特点尺寸缩小到50nm时，电路组合逻辑部分引发的软错误率将与时序逻辑部分的软错误率相称。而Intel最新推出的westm（略..）ere-EP处理器中已经采取了32nm技巧。这阐明组合逻辑单元软错误对电路坚固性的影响已经可能达到甚至超过期序逻辑单元软错误对电路坚固性的影响。跟着电路组合逻辑部分的软错误率的升高，组合逻辑部分的软错误研究变得越来越重要。已有的实用于数（此处忽略..）字电路体系级坚固性分析的方法重要有两类，即基于故障模仿的方法跟基于情势化技巧的方法。基于故障模仿的方法利用最广泛，然而这类方法很难实现输入空间跟故障空间的完全覆盖，是不齐备的。基于情势化技巧的方法固然可能保障分析成果的齐备性，然罢了（略..）有的方法重要是基于模型测验跟定理证明的。这些方法都须要较多的教训跟专家支撑，定理证明还须要手工干涉。本文提出了基于组合逻辑部分的错误传播模型跟时序等价性检查技巧的组合逻辑单元软错误敏感点筛选方法。该方法首先从电路中提取组合逻辑单元软（文章此处忽略..）错误的传播行动模型，而后基于该模型对故障电路与原电路进行等价性检查，辨认对软错误敏感的组合逻辑单元。实验成果表明，本文提出的方法可能正确地筛选出电路中所有的软错误敏感点，可能用于避免对不敏感点的适度保护，减小电路容错代价。

以上为本篇毕业论文范文基于时序等价性检查的组合逻辑单元软错误坚固性分析的介绍部分。

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