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HDLC协定把持器软IP核设计

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毕业论文范文题目：HDLC协定把持器软IP核设计，论文范文关键词：HDLC协定把持器软IP核设计
HDLC协定把持器软IP核设计毕业论文范文介绍开始：
【论文摘要】：数据通信技巧跟微电子技巧在贸易上的成功利用,使得电子产品市场的竞争日益激烈。急切请求缩短电子产品设计的开发周期,按照市场的须要设计出以高坚固性、低造价、功能强的高机能电子产品。设计复用是进步集成电路设计效力的有效方法,SOC(SystemOnaChip)是将来集成电路发展的必定趋势,IP核的利用是使设计复用跟SOC设计得以进行的重要手段之一,基于IP核复用的设计方法,可能有效地促（略..）进片上体系SOC的实现,发挥着宏大的作用。HDLC(High-LevelDataLinkControl)是由国际标准化组织(ISO)制订的高等数据链路把持规程。HDLC被广泛地用作数据链路的把持协定,很多数据链路协定如LAPB、LAPD、LLC跟SDLC协定都是基于HDLC协定修改的。然而目前的HDLC产品基本上是国外的,所以设计存在自主常识产权的HDLC协定把持器软IP核有侧重要的（本文此处忽略..）意思。CRC(CyclicalRedundancyCheck)轮回冗余校验是HDLC协定的重要组成部分,通信双方通过CRC校验实现对帧的检测,用来断定所接收的数据是否产生错误。CRC校验技巧的基本原理是同一的,然而切实现算法却有多种,直到当初,仍然有新的CRC实现方法始终呈现。CRC实现方法大抵可能分为三种:软件方法;用硬件实现的串行方法;用硬件实现的并行算法。所谓并行算法,它是（此处忽略..）绝对串行算法而言的,每次打算多位比特数据,进步CRC打算的速度。本文所做的工作重要包含两个方面:一、针对HDLC协定的重要组成部分CRC轮回冗余校验,以CRC轮回冗余校验原理为基本,对CRC并行算法进行实际推导,通过对传统串行CRC-CCITT电路中各移位存放器状况的分析,推导出并行算法的逻辑关联式,利用VerilogHDL硬件描述语言实现了并行CRC-CCITT算法,并给出（此处忽略..）仿真成果,仿真成果表明与串行算法比拟并行算法进步了校验效力。二、在分析跟研究HDLC数据链路协定的基本上,以Top-Down自顶向下设计方法给出了一种HDLC协定把持器的软IP核打算,在QuartusⅡ软件进行设计,用VerilogHDL硬件描述语言进行了行动级描述,采取Modelsim软件进行仿真,仿真成果表明设计的软IP核实现了HDLC协定把持器的功能。

以上为本篇毕业论文范文HDLC协定把持器软IP核设计的介绍部分。

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