EDA技术设计多功能电子钟

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毕业论文范文题目： EDA技术设计多功能电子钟，论文范文关键词： EDA技术设计多功能电子钟
EDA技术设计多功能电子钟毕业论文范文介绍开始：
　　本科毕业设计 EDA技术设计多功能电子钟
　　verilog hdl|电子钟|多功能|EDA
　　文件格式：word
　　
　　本科毕业设计 EDA技术设计多功能电子钟
　　一套完整的毕业设计，包括任务书、开题报告、论文正文、外文翻译。
　　有预览文件请查看。
　　
　　论文正文共51页。共24870个字符数（不计空格）。整套压缩包大小：600KB。
　　外文翻译 Based on FPGA digital TV CSD filter to image signal format conversion（基于FPGA数字电视CSD滤波器对图像信号格式转换）。
　　
　　EDA设计多功能电子时钟
　　
　　摘要：随着大规模集成电路技术和计算机技术的不断发展，在涉及通信、国防、航天、医学、工业自动化、计算机应用、仪器仪表等领域的电子系统设计工作中，EDA技术的含量正以惊人的速度上升;电子类的高新技术项目的开发也日益依赖于EDA技术的应用。即使是普通的电子产品的开发，EDA技术常常使一些原来的技术瓶颈得以轻松突破，从而使产品的开发周期大为缩短、性能价格比大幅提高。不言而喻，EDA技术将迅速成为电子设计领域中的极其重要的组成部分
　　本实验阐述了基于EDA设计软件Quartus II 提供的FPGA/CPLD开发集成环境，结合verilg hdl语言以及组合电路等来设计多功能数字钟的方法。该数字钟具有校时、校分、清零、保持、闹铃、秒表等功能。本实验用Verilog hdl语言实现了分频、计数、等功能，并利用原理图完成了计时模块、报时模块、译码显示模块、闹铃模块、秒表模块等的设计。通过按键可由正常计时状态切换到闹铃状态，闹铃模块通过比较设定时间与实际时间，一致时触发铃声。该数字钟原理简单，功能可根据需要继续添加.具有功能多、操作简单、性能可靠。
　　
　　关键字： verilog hdl,电子钟,多功能,EDA。
　　
　　EDA multi-function electronic clock
　　
　　Abstract ：Along with large scale integrated circuit technology and development of computer technology, communication, national defense, in which space, medical, industrial automation, computer application, instruments and other areas of electronic system design work, the content of EDA technology is developing at a breathtaking speed up; Electronics high-tech project development also more than benefit depends on EDA technology application. Even ordinary electronic product development, EDA technology often make some originally the technical bottleneck to break easily, so as to make the development of the product cycle is much shorter, performance to price increase. Self-evident, EDA will quickly become a technology in the field of electronic design of the most important components
　　 It is presented based on the experiment EDA software Quartus II provides the FPGA/CPLD integrated development environment, combined with verilg HDL language and circuit design and multi-function combination of digital clock method. The digital clock with the school, the school to points when, reset, keep, and time on the hour, alarm, a stopwatch etc.
　　
　　Function. This experiment with Verilog HDL language realized the points, counting, and comparison of the frequency response function and use principle diagram completed the timer modules, time module, decode display module, alarm module, a stopwatch module design. Through the buttons can be made of normal time state switch to alarm condition, alarm module by comparing with the actual time set time, consistent triggered when the bell ring. The digital clock simple principle, function can according to need to continue to add. Has the function is much, the operation is simple, reliable performance.
　　key word ：verilog hdl,electric clock,multifunctional,EDA.
　　
　　目录
　　
　　摘要 II
　　Abstract II
　　绪论 1
　　第一章、本毕业设计的目的 2
　　第二章、FPGA/CPLD的特点 2
　　第三章、设计要求说明 2
　　第四章、方案论证 4
　　4.1 根据设计要求完成以下功能模块 4
　　4.1.1 实验数字钟的计时功能 4
　　4.1.2 实现控制按键去抖动功能 4
　　4.1.3 实现数字钟的校时校分功能 4
　　4.1.4 实现数字钟的清零、保持功能 4
　　4.1.5 要实现闹钟功能 4
　　4.1.6 增加秒表功能 5
　　4.2 电路整体设计 5
　　第五章、各子模块设计原理 5
　　5.1 防抖动程序 5
　　5.2 计时模块 6
　　5.3 秒表功能模块 13
　　5.4 校时功能模块 18
　　5.5 闹钟功能模块 23
　　第六章、切换模态、设置闹钟时间并消颤 30
　　第七章、引脚设置与仿真 30
　　第八章、实验中遇到问题 32
　　第九章、感想 32
　　参考文献(References) 33
　　附件1 33

以上为本篇毕业论文范文 EDA技术设计多功能电子钟的介绍部分。

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