支撑不同束缚长度Viterbi译码器的设计实现与重构

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支撑不同束缚长度Viterbi译码器的设计实现与重构

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毕业论文范文题目：支撑不同束缚长度Viterbi译码器的设计实现与重构，论文范文关键词：支撑不同束缚长度Viterbi译码器的设计实现与重构
支撑不同束缚长度Viterbi译码器的设计实现与重构毕业论文范文介绍开始：
【论文摘要】：Viterbi译码器是古代无线通信体系的重要组成部分之一,重要用于前向纠错技巧中卷积码的解码。现今,不同通信标准定义的卷积编码参数不同(如束缚长度、编码速率),以往固定参数的Viterbi译码器已经不能满意利用的须要,且不能实现不同通信标准的兼容跟自由切换。可重构体系存在通用处理器跟ASIC两者的长处,可能提供硬件的效力跟软件（文章此处忽略..）的可编程性,是一种以硬件重载的方法将一个纯空间的数字体系化解为时光上可混淆构建的数字逻辑体系,与单片机、数字信号处理器等采取软件编程方法来实现体系功能的硬件实现方法有本质上的差别。这种新型的数字逻辑体系从时光轴、外部功能看上去跟原有系同一样,但从元胞资源来讲,因为资源可能反复利用,资源利用率将成倍的进步,体系的硬件范围将大（本文此处忽略..）大降落,其重要硬件载体是基于SRAM编程的FPGA。本文将可重构技巧利用于Viterbi译码器设计,采取一种新的流水构造设计Viterbi译码器,易于重构,可支撑束缚长度为7,8,9三种编码参数的卷积解码。ACS模块的设计采取原位更新打算方法,并奇妙安排打算状况次序,一次迭代运算实现后通过交换网络还原幸存道路信息的次序,这样节俭（略..）存储资源。译码输出采取单指针回溯方法,易于提取基核单元跟参数。此外,本文还提出两种重构策略,一种是基于参数化的重构方法,另一种是自适应动态重构策略。不同束缚长度跟编码矢量的Viterbi译码器的硬件构造有很大的类似性,参数化重构策略正好合乎这一特点,且重构的文件小,易于实现,重构时光短,可实现硬件功能的外部接续。自适应动态（此处忽略..）重构策略是根据自适应Viterbi译码算法提出的一种重构策略,可根据信道的信噪比自适应配置不同参数的译码器,大大减少打算量。本设计在XilinxFPGA的软、硬开发平台上实现,仿实在验表明该设计可能实现不同束缚长度的卷积码译码。通过比较显示,论文给出的构造存在必定的通用性,且在资源利用方面存在必定的上风。

以上为本篇毕业论文范文支撑不同束缚长度Viterbi译码器的设计实现与重构的介绍部分。

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