工作台的控制设计部分闭环控制的伺服系统设计

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工作台的控制设计部分闭环控制的伺服系统设计(三)

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工作台的控制设计部分闭环控制的伺服系统设计(三)毕业论文范文介绍开始：
此将不再祥述。
A/D转换过程需要一定时间，为防止产生误差，要求在此期间内保持采样信号不变，实现这一功能的电路称采样/保持电路。典型的采样/保持电路由模拟开关保持电容和运算放大器组成，如图2.9所示。运算放大器N1和N2接成跟随器，作缓冲器用。当控制信号UC为高电平时，场效应管VF导
通，对输入信号采样。输入信号ui通过N1和VF向电容C充电,并通过N2输出uo。由于N1的阻抗很小，N2的输入阻抗很大，因而在VF导通期间，uo=ui。当UC为低电平时，VF截止，电容C将采样期间的信号电平保持下
来，并经N2缓冲输出。在该电路中，场效应管VF即为采样开关，其关断电阻和N2的输入阻抗约稿，C的泄漏电阻越大，uo的保持时间越长，保持精度越好。
预处理的任务是去除干扰信号。干扰信号由周期干扰和随机干扰两类。周期干扰由50HZ的功频干扰，采用积分时间为200m整数倍的双积分型A/D转换其，可有效地消除干扰。对于随机干扰，可采用数字滤波的方法低通滤波予以削弱或消除。

第三章接口设计

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